GK SDK 源码库: XMIPCLinuxV100R005C00SPC030 (kernel/tools/open_source excluded)
This commit is contained in:
@@ -0,0 +1,6 @@
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menu "Initial register configuration"
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source "arch/powerpc/cpu/mpc83xx/initreg/Kconfig.spcr"
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source "arch/powerpc/cpu/mpc83xx/initreg/Kconfig.lcrr"
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endmenu
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@@ -0,0 +1,139 @@
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menu "LCRR - Clock Ratio Register register"
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if !ARCH_MPC8309 && !ARCH_MPC831X && !ARCH_MPC832X
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choice
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prompt "DLL bypass"
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config LCRR_DBYP_UNSET
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bool "Don't set value"
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config LCRR_DBYP_PLL_ENABLED
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bool "PLL enabled"
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config LCRR_DBYP_PLL_BYPASSED
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bool "PLL bypassed"
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endchoice
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||||
endif
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if ARCH_MPC834X || ARCH_MPC8360
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choice
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prompt "Additional delay cycles for SDRAM control signals"
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config LCRR_BUFCMDC_UNSET
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bool "Don't set value"
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config LCRR_BUFCMDC_4
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bool "4"
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config LCRR_BUFCMDC_1
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bool "1"
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config LCRR_BUFCMDC_2
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bool "2"
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config LCRR_BUFCMDC_3
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bool "3"
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endchoice
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choice
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prompt "Extended CAS latency"
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config LCRR_ECL_UNSET
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bool "Don't set value"
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config LCRR_ECL_4
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bool "4"
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config LCRR_ECL_5
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bool "5"
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config LCRR_ECL_6
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bool "6"
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config LCRR_ECL_7
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bool "7"
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endchoice
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endif # ARCH_MPC834X || ARCH_MPC8360
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if !ARCH_MPC8308
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choice
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prompt "External address delay cycles"
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config LCRR_EADC_UNSET
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bool "Don't set value"
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config LCRR_EADC_4
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bool "4"
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config LCRR_EADC_1
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bool "1"
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config LCRR_EADC_2
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bool "2"
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config LCRR_EADC_3
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bool "3"
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endchoice
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||||
endif # !ARCH_MPC8308
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choice
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prompt "System clock divider"
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config LCRR_CLKDIV_UNSET
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bool "Don't set value"
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config LCRR_CLKDIV_2
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bool "2"
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config LCRR_CLKDIV_4
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bool "4"
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config LCRR_CLKDIV_8
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bool "8"
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endchoice
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config LCRR_DBYP
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hex
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||||
default 0x0 if LCRR_DBYP_UNSET || LCRR_DBYP_PLL_ENABLED
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||||
default 0x80000000 if LCRR_DBYP_PLL_BYPASSED
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||||
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||||
config LCRR_BUFCMDC
|
||||
hex
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||||
default 0x0 if LCRR_BUFCMDC_4 || LCRR_BUFCMDC_UNSET
|
||||
default 0x10000000 if LCRR_BUFCMDC_1
|
||||
default 0x20000000 if LCRR_BUFCMDC_2
|
||||
default 0x30000000 if LCRR_BUFCMDC_3
|
||||
|
||||
config LCRR_ECL
|
||||
hex
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||||
default 0x0 if LCRR_ECL_4 || LCRR_ECL_UNSET
|
||||
default 0x1000000 if LCRR_ECL_5
|
||||
default 0x2000000 if LCRR_ECL_6
|
||||
default 0x3000000 if LCRR_ECL_7
|
||||
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||||
config LCRR_EADC
|
||||
hex
|
||||
default 0x0 if LCRR_EADC_4 || LCRR_EADC_UNSET
|
||||
default 0x10000 if LCRR_EADC_1
|
||||
default 0x20000 if LCRR_EADC_2
|
||||
default 0x30000 if LCRR_EADC_3
|
||||
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||||
config LCRR_CLKDIV
|
||||
hex
|
||||
default 0x0 if LCRR_CLKDIV_UNSET
|
||||
default 0x2 if LCRR_CLKDIV_2
|
||||
default 0x4 if LCRR_CLKDIV_4
|
||||
default 0x8 if LCRR_CLKDIV_8
|
||||
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||||
endmenu
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@@ -0,0 +1,115 @@
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||||
menu "SPCR - System priority and configuration register"
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choice
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||||
prompt "Optimize"
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config SPCR_OPT_UNSET
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bool "Don't set value"
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config SPCR_OPT_NONE
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||||
bool "No performance enhancement"
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||||
config SPCR_OPT_SPEC_READ
|
||||
bool "Performance enhancement by speculative read"
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endchoice
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||||
if ARCH_MPC8308 || ARCH_MPC831X || ARCH_MPC837X
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||||
choice
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||||
prompt "TSEC emergency priority"
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||||
config SPCR_TSECEP_UNSET
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||||
bool "Don't set value"
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|
||||
config SPCR_TSECEP_0
|
||||
bool "Level 0 (lowest priority)"
|
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||||
config SPCR_TSECEP_1
|
||||
bool "Level 1"
|
||||
|
||||
config SPCR_TSECEP_2
|
||||
bool "Level 2"
|
||||
|
||||
config SPCR_TSECEP_3
|
||||
bool "Level 3 (highest priority)"
|
||||
|
||||
endchoice
|
||||
|
||||
endif
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||||
if ARCH_MPC8349
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||||
choice
|
||||
prompt "TSEC1 emergency priority"
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||||
config SPCR_TSEC1EP_UNSET
|
||||
bool "Don't set value"
|
||||
|
||||
config SPCR_TSEC1EP_0
|
||||
bool "Level 0 (lowest priority)"
|
||||
|
||||
config SPCR_TSEC1EP_1
|
||||
bool "Level 1"
|
||||
|
||||
config SPCR_TSEC1EP_2
|
||||
bool "Level 2"
|
||||
|
||||
config SPCR_TSEC1EP_3
|
||||
bool "Level 3 (highest priority)"
|
||||
|
||||
endchoice
|
||||
|
||||
choice
|
||||
prompt "TSEC2 emergency priority"
|
||||
|
||||
config SPCR_TSEC2EP_UNSET
|
||||
bool "Don't set value"
|
||||
|
||||
config SPCR_TSEC2EP_0
|
||||
bool "Level 0 (lowest priority)"
|
||||
|
||||
config SPCR_TSEC2EP_1
|
||||
bool "Level 1"
|
||||
|
||||
config SPCR_TSEC2EP_2
|
||||
bool "Level 2"
|
||||
|
||||
config SPCR_TSEC2EP_3
|
||||
bool "Level 3 (highest priority)"
|
||||
|
||||
endchoice
|
||||
|
||||
endif
|
||||
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||||
config SPCR_OPT
|
||||
hex
|
||||
default 0x0 if SPCR_OPT_UNSET
|
||||
default 0x0 if SPCR_OPT_NONE
|
||||
default 0x800000 if SPCR_OPT_SPEC_READ
|
||||
|
||||
config SPCR_TSECEP
|
||||
hex
|
||||
default 0x0 if SPCR_TSECEP_UNSET
|
||||
default 0x0 if SPCR_TSECEP_0
|
||||
default 0x100 if SPCR_TSECEP_1
|
||||
default 0x200 if SPCR_TSECEP_2
|
||||
default 0x300 if SPCR_TSECEP_3
|
||||
|
||||
config SPCR_TSEC1EP
|
||||
hex
|
||||
default 0x0 if SPCR_TSEC1EP_UNSET
|
||||
default 0x0 if SPCR_TSEC1EP_0
|
||||
default 0x100 if SPCR_TSEC1EP_1
|
||||
default 0x200 if SPCR_TSEC1EP_2
|
||||
default 0x300 if SPCR_TSEC1EP_3
|
||||
|
||||
config SPCR_TSEC2EP
|
||||
hex
|
||||
default 0x0 if SPCR_TSEC2EP_UNSET
|
||||
default 0x0 if SPCR_TSEC2EP_0
|
||||
default 0x1 if SPCR_TSEC2EP_1
|
||||
default 0x2 if SPCR_TSEC2EP_2
|
||||
default 0x3 if SPCR_TSEC2EP_3
|
||||
|
||||
endmenu
|
||||
@@ -0,0 +1,79 @@
|
||||
#define SPCR_PCIHPE_MASK 0x10000000
|
||||
#define SPCR_PCIPR_MASK 0x03000000
|
||||
#define SPCR_OPT_MASK 0x00800000
|
||||
#define SPCR_TBEN_MASK 0x00400000
|
||||
#define SPCR_COREPR_MASK 0x00300000
|
||||
#define SPCR_TSEC1DP_MASK 0x00003000
|
||||
#define SPCR_TSEC1BDP_MASK 0x00000C00
|
||||
#define SPCR_TSEC1EP_MASK 0x00000300
|
||||
#define SPCR_TSEC2DP_MASK 0x00000030
|
||||
#define SPCR_TSEC2BDP_MASK 0x0000000C
|
||||
#define SPCR_TSEC2EP_MASK 0x00000003
|
||||
#define SPCR_TSECDP_MASK 0x00003000
|
||||
#define SPCR_TSECBDP_MASK 0x00000C00
|
||||
#define SPCR_TSECEP_MASK 0x00000300
|
||||
|
||||
const __be32 spcr_mask =
|
||||
#if defined(CONFIG_SPCR_OPT) && !defined(CONFIG_SPCR_OPT_UNSET)
|
||||
SPCR_OPT_MASK |
|
||||
#endif
|
||||
#if defined(CONFIG_SPCR_TSECEP) && !defined(CONFIG_SPCR_TSECEP_UNSET)
|
||||
SPCR_TSECEP_MASK |
|
||||
#endif
|
||||
#if defined(CONFIG_SPCR_TSEC1EP) && !defined(CONFIG_SPCR_TSEC1EP_UNSET)
|
||||
SPCR_TSEC1EP_MASK |
|
||||
#endif
|
||||
#if defined(CONFIG_SPCR_TSEC2EP) && !defined(CONFIG_SPCR_TSEC2EP_UNSET)
|
||||
SPCR_TSEC2EP_MASK |
|
||||
#endif
|
||||
0;
|
||||
const __be32 spcr_val =
|
||||
#if defined(CONFIG_SPCR_OPT) && !defined(CONFIG_SPCR_OPT_UNSET)
|
||||
CONFIG_SPCR_OPT |
|
||||
#endif
|
||||
#if defined(CONFIG_SPCR_TSECEP) && !defined(CONFIG_SPCR_TSECEP_UNSET)
|
||||
CONFIG_SPCR_TSECEP |
|
||||
#endif
|
||||
#if defined(CONFIG_SPCR_TSEC1EP) && !defined(CONFIG_SPCR_TSEC1EP_UNSET)
|
||||
CONFIG_SPCR_TSEC1EP |
|
||||
#endif
|
||||
#if defined(CONFIG_SPCR_TSEC2EP) && !defined(CONFIG_SPCR_TSEC2EP_UNSET)
|
||||
CONFIG_SPCR_TSEC2EP |
|
||||
#endif
|
||||
0;
|
||||
|
||||
const __be32 lcrr_mask =
|
||||
#if defined(CONFIG_LCRR_DBYP) && !defined(CONFIG_LCRR_DBYP_UNSET)
|
||||
LCRR_DBYP |
|
||||
#endif
|
||||
#if defined(CONFIG_LCRR_BUFCMDC) && !defined(CONFIG_LCRR_BUFCMDC_UNSET)
|
||||
LCRR_BUFCMDC |
|
||||
#endif
|
||||
#if defined(CONFIG_LCRR_ECL) && !defined(CONFIG_LCRR_ECL_UNSET)
|
||||
LCRR_ECL |
|
||||
#endif
|
||||
#if defined(CONFIG_LCRR_EADC) && !defined(CONFIG_LCRR_EADC_UNSET)
|
||||
LCRR_EADC |
|
||||
#endif
|
||||
#if defined(CONFIG_LCRR_CLKDIV) && !defined(CONFIG_LCRR_CLKDIV_UNSET)
|
||||
LCRR_CLKDIV |
|
||||
#endif
|
||||
0;
|
||||
|
||||
const __be32 lcrr_val =
|
||||
#if defined(CONFIG_LCRR_DBYP) && !defined(CONFIG_LCRR_DBYP_UNSET)
|
||||
CONFIG_LCRR_DBYP |
|
||||
#endif
|
||||
#if defined(CONFIG_LCRR_BUFCMDC) && !defined(CONFIG_LCRR_BUFCMDC_UNSET)
|
||||
CONFIG_LCRR_BUFCMDC |
|
||||
#endif
|
||||
#if defined(CONFIG_LCRR_ECL) && !defined(CONFIG_LCRR_ECL_UNSET)
|
||||
CONFIG_LCRR_ECL |
|
||||
#endif
|
||||
#if defined(CONFIG_LCRR_EADC) && !defined(CONFIG_LCRR_EADC_UNSET)
|
||||
CONFIG_LCRR_EADC |
|
||||
#endif
|
||||
#if defined(CONFIG_LCRR_CLKDIV) && !defined(CONFIG_LCRR_CLKDIV_UNSET)
|
||||
CONFIG_LCRR_CLKDIV |
|
||||
#endif
|
||||
0;
|
||||
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