GK SDK 源码库: XMIPCLinuxV100R005C00SPC030 (kernel/tools/open_source excluded)
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@@ -0,0 +1,394 @@
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/*
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* Copyright (c) 2015-2019, Renesas Electronics Corporation. All rights reserved.
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*
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* SPDX-License-Identifier: BSD-3-Clause
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*/
|
||||
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||||
#include <stdint.h>
|
||||
|
||||
#include <common/debug.h>
|
||||
#include <lib/mmio.h>
|
||||
|
||||
#include "qos_init.h"
|
||||
#include "qos_common.h"
|
||||
#include "qos_reg.h"
|
||||
#include "rcar_def.h"
|
||||
#if RCAR_LSI == RCAR_AUTO
|
||||
#include "H3/qos_init_h3_v10.h"
|
||||
#include "H3/qos_init_h3_v11.h"
|
||||
#include "H3/qos_init_h3_v20.h"
|
||||
#include "H3/qos_init_h3_v30.h"
|
||||
#include "M3/qos_init_m3_v10.h"
|
||||
#include "M3/qos_init_m3_v11.h"
|
||||
#include "M3/qos_init_m3_v30.h"
|
||||
#include "M3N/qos_init_m3n_v10.h"
|
||||
#include "V3M/qos_init_v3m.h"
|
||||
#endif
|
||||
#if RCAR_LSI == RCAR_H3 /* H3 */
|
||||
#include "H3/qos_init_h3_v10.h"
|
||||
#include "H3/qos_init_h3_v11.h"
|
||||
#include "H3/qos_init_h3_v20.h"
|
||||
#include "H3/qos_init_h3_v30.h"
|
||||
#endif
|
||||
#if RCAR_LSI == RCAR_H3N /* H3 */
|
||||
#include "H3/qos_init_h3n_v30.h"
|
||||
#endif
|
||||
#if RCAR_LSI == RCAR_M3 /* M3 */
|
||||
#include "M3/qos_init_m3_v10.h"
|
||||
#include "M3/qos_init_m3_v11.h"
|
||||
#include "M3/qos_init_m3_v30.h"
|
||||
#endif
|
||||
#if RCAR_LSI == RCAR_M3N /* M3N */
|
||||
#include "M3N/qos_init_m3n_v10.h"
|
||||
#endif
|
||||
#if RCAR_LSI == RCAR_V3M /* V3M */
|
||||
#include "V3M/qos_init_v3m.h"
|
||||
#endif
|
||||
#if RCAR_LSI == RCAR_E3 /* E3 */
|
||||
#include "E3/qos_init_e3_v10.h"
|
||||
#endif
|
||||
#if RCAR_LSI == RCAR_D3 /* D3 */
|
||||
#include "D3/qos_init_d3.h"
|
||||
#endif
|
||||
|
||||
#if (RCAR_LSI != RCAR_E3) && (RCAR_LSI != RCAR_D3) && (RCAR_LSI != RCAR_V3M)
|
||||
|
||||
#define DRAM_CH_CNT 0x04
|
||||
uint32_t qos_init_ddr_ch;
|
||||
uint8_t qos_init_ddr_phyvalid;
|
||||
#endif
|
||||
|
||||
#define PRR_PRODUCT_ERR(reg) \
|
||||
do { \
|
||||
ERROR("LSI Product ID(PRR=0x%x) QoS " \
|
||||
"initialize not supported.\n", reg); \
|
||||
panic(); \
|
||||
} while (0)
|
||||
|
||||
#define PRR_CUT_ERR(reg) \
|
||||
do { \
|
||||
ERROR("LSI Cut ID(PRR=0x%x) QoS " \
|
||||
"initialize not supported.\n", reg); \
|
||||
panic(); \
|
||||
} while (0)
|
||||
|
||||
void rcar_qos_init(void)
|
||||
{
|
||||
uint32_t reg;
|
||||
#if (RCAR_LSI != RCAR_E3) && (RCAR_LSI != RCAR_D3) && (RCAR_LSI != RCAR_V3M)
|
||||
uint32_t i;
|
||||
|
||||
qos_init_ddr_ch = 0;
|
||||
qos_init_ddr_phyvalid = get_boardcnf_phyvalid();
|
||||
for (i = 0; i < DRAM_CH_CNT; i++) {
|
||||
if ((qos_init_ddr_phyvalid & (1 << i))) {
|
||||
qos_init_ddr_ch++;
|
||||
}
|
||||
}
|
||||
#endif
|
||||
|
||||
reg = mmio_read_32(PRR);
|
||||
#if (RCAR_LSI == RCAR_AUTO) || RCAR_LSI_CUT_COMPAT
|
||||
switch (reg & PRR_PRODUCT_MASK) {
|
||||
case PRR_PRODUCT_H3:
|
||||
#if (RCAR_LSI == RCAR_AUTO) || (RCAR_LSI == RCAR_H3)
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_10:
|
||||
qos_init_h3_v10();
|
||||
break;
|
||||
case PRR_PRODUCT_11:
|
||||
qos_init_h3_v11();
|
||||
break;
|
||||
case PRR_PRODUCT_20:
|
||||
qos_init_h3_v20();
|
||||
break;
|
||||
case PRR_PRODUCT_30:
|
||||
default:
|
||||
qos_init_h3_v30();
|
||||
break;
|
||||
}
|
||||
#elif (RCAR_LSI == RCAR_H3N)
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_30:
|
||||
default:
|
||||
qos_init_h3n_v30();
|
||||
break;
|
||||
}
|
||||
#else
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
#endif
|
||||
break;
|
||||
case PRR_PRODUCT_M3:
|
||||
#if (RCAR_LSI == RCAR_AUTO) || (RCAR_LSI == RCAR_M3)
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_10:
|
||||
qos_init_m3_v10();
|
||||
break;
|
||||
case PRR_PRODUCT_21: /* M3 Cut 13 */
|
||||
qos_init_m3_v11();
|
||||
break;
|
||||
case PRR_PRODUCT_30: /* M3 Cut 30 */
|
||||
default:
|
||||
qos_init_m3_v30();
|
||||
break;
|
||||
}
|
||||
#else
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
#endif
|
||||
break;
|
||||
case PRR_PRODUCT_M3N:
|
||||
#if (RCAR_LSI == RCAR_AUTO) || (RCAR_LSI == RCAR_M3N)
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_10:
|
||||
default:
|
||||
qos_init_m3n_v10();
|
||||
break;
|
||||
}
|
||||
#else
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
#endif
|
||||
break;
|
||||
case PRR_PRODUCT_V3M:
|
||||
#if (RCAR_LSI == RCAR_AUTO) || (RCAR_LSI == RCAR_V3M)
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_10:
|
||||
case PRR_PRODUCT_20:
|
||||
default:
|
||||
qos_init_v3m();
|
||||
break;
|
||||
}
|
||||
#else
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
#endif
|
||||
break;
|
||||
case PRR_PRODUCT_E3:
|
||||
#if (RCAR_LSI == RCAR_E3)
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_10:
|
||||
default:
|
||||
qos_init_e3_v10();
|
||||
break;
|
||||
}
|
||||
#else
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
#endif
|
||||
break;
|
||||
case PRR_PRODUCT_D3:
|
||||
#if (RCAR_LSI == RCAR_D3)
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_10:
|
||||
default:
|
||||
qos_init_d3();
|
||||
break;
|
||||
}
|
||||
#else
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
#endif
|
||||
break;
|
||||
default:
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
break;
|
||||
}
|
||||
#else
|
||||
#if RCAR_LSI == RCAR_H3 /* H3 */
|
||||
#if RCAR_LSI_CUT == RCAR_CUT_10
|
||||
/* H3 Cut 10 */
|
||||
if ((PRR_PRODUCT_H3 | PRR_PRODUCT_10)
|
||||
!= (reg & (PRR_PRODUCT_MASK | PRR_CUT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_h3_v10();
|
||||
#elif RCAR_LSI_CUT == RCAR_CUT_11
|
||||
/* H3 Cut 11 */
|
||||
if ((PRR_PRODUCT_H3 | PRR_PRODUCT_11)
|
||||
!= (reg & (PRR_PRODUCT_MASK | PRR_CUT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_h3_v11();
|
||||
#elif RCAR_LSI_CUT == RCAR_CUT_20
|
||||
/* H3 Cut 20 */
|
||||
if ((PRR_PRODUCT_H3 | PRR_PRODUCT_20)
|
||||
!= (reg & (PRR_PRODUCT_MASK | PRR_CUT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_h3_v20();
|
||||
#else
|
||||
/* H3 Cut 30 or later */
|
||||
if ((PRR_PRODUCT_H3)
|
||||
!= (reg & (PRR_PRODUCT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_h3_v30();
|
||||
#endif
|
||||
#elif RCAR_LSI == RCAR_H3N /* H3 */
|
||||
/* H3N Cut 30 or later */
|
||||
if ((PRR_PRODUCT_H3)
|
||||
!= (reg & (PRR_PRODUCT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_h3n_v30();
|
||||
#elif RCAR_LSI == RCAR_M3 /* M3 */
|
||||
#if RCAR_LSI_CUT == RCAR_CUT_10
|
||||
/* M3 Cut 10 */
|
||||
if ((PRR_PRODUCT_M3 | PRR_PRODUCT_10)
|
||||
!= (reg & (PRR_PRODUCT_MASK | PRR_CUT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_m3_v10();
|
||||
#elif RCAR_LSI_CUT == RCAR_CUT_11
|
||||
/* M3 Cut 11 */
|
||||
if ((PRR_PRODUCT_M3 | PRR_PRODUCT_20)
|
||||
!= (reg & (PRR_PRODUCT_MASK | PRR_CUT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_m3_v11();
|
||||
#elif RCAR_LSI_CUT == RCAR_CUT_13
|
||||
/* M3 Cut 13 */
|
||||
if ((PRR_PRODUCT_M3 | PRR_PRODUCT_21)
|
||||
!= (reg & (PRR_PRODUCT_MASK | PRR_CUT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_m3_v11();
|
||||
#else
|
||||
/* M3 Cut 30 or later */
|
||||
if ((PRR_PRODUCT_M3)
|
||||
!= (reg & (PRR_PRODUCT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_m3_v30();
|
||||
#endif
|
||||
#elif RCAR_LSI == RCAR_M3N /* M3N */
|
||||
/* M3N Cut 10 or later */
|
||||
if ((PRR_PRODUCT_M3N)
|
||||
!= (reg & (PRR_PRODUCT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_m3n_v10();
|
||||
#elif RCAR_LSI == RCAR_V3M /* V3M */
|
||||
/* V3M Cut 10 or later */
|
||||
if ((PRR_PRODUCT_V3M)
|
||||
!= (reg & (PRR_PRODUCT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_v3m();
|
||||
#elif RCAR_LSI == RCAR_D3 /* D3 */
|
||||
/* D3 Cut 10 or later */
|
||||
if ((PRR_PRODUCT_D3)
|
||||
!= (reg & (PRR_PRODUCT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_d3();
|
||||
#elif RCAR_LSI == RCAR_E3 /* E3 */
|
||||
/* E3 Cut 10 or later */
|
||||
if ((PRR_PRODUCT_E3)
|
||||
!= (reg & (PRR_PRODUCT_MASK))) {
|
||||
PRR_PRODUCT_ERR(reg);
|
||||
}
|
||||
qos_init_e3_v10();
|
||||
#else
|
||||
#error "Don't have QoS initialize routine(Unknown chip)."
|
||||
#endif
|
||||
#endif
|
||||
}
|
||||
|
||||
#if (RCAR_LSI != RCAR_E3) && (RCAR_LSI != RCAR_D3) && (RCAR_LSI != RCAR_V3M)
|
||||
uint32_t get_refperiod(void)
|
||||
{
|
||||
uint32_t refperiod = QOSWT_WTSET0_CYCLE;
|
||||
|
||||
#if (RCAR_LSI == RCAR_AUTO) || RCAR_LSI_CUT_COMPAT
|
||||
uint32_t reg;
|
||||
|
||||
reg = mmio_read_32(PRR);
|
||||
switch (reg & PRR_PRODUCT_MASK) {
|
||||
#if (RCAR_LSI == RCAR_AUTO) || (RCAR_LSI == RCAR_H3)
|
||||
case PRR_PRODUCT_H3:
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_10:
|
||||
case PRR_PRODUCT_11:
|
||||
break;
|
||||
case PRR_PRODUCT_20:
|
||||
case PRR_PRODUCT_30:
|
||||
default:
|
||||
refperiod = REFPERIOD_CYCLE;
|
||||
break;
|
||||
}
|
||||
break;
|
||||
#elif (RCAR_LSI == RCAR_H3N)
|
||||
case PRR_PRODUCT_H3:
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_30:
|
||||
default:
|
||||
refperiod = REFPERIOD_CYCLE;
|
||||
break;
|
||||
}
|
||||
break;
|
||||
#endif
|
||||
#if (RCAR_LSI == RCAR_AUTO) || (RCAR_LSI == RCAR_M3)
|
||||
case PRR_PRODUCT_M3:
|
||||
switch (reg & PRR_CUT_MASK) {
|
||||
case PRR_PRODUCT_10:
|
||||
break;
|
||||
case PRR_PRODUCT_20: /* M3 Cut 11 */
|
||||
case PRR_PRODUCT_21: /* M3 Cut 13 */
|
||||
case PRR_PRODUCT_30: /* M3 Cut 30 */
|
||||
default:
|
||||
refperiod = REFPERIOD_CYCLE;
|
||||
break;
|
||||
}
|
||||
break;
|
||||
#endif
|
||||
#if (RCAR_LSI == RCAR_AUTO) || (RCAR_LSI == RCAR_M3N)
|
||||
case PRR_PRODUCT_M3N:
|
||||
refperiod = REFPERIOD_CYCLE;
|
||||
break;
|
||||
#endif
|
||||
default:
|
||||
break;
|
||||
}
|
||||
#elif RCAR_LSI == RCAR_H3
|
||||
#if RCAR_LSI_CUT == RCAR_CUT_10
|
||||
/* H3 Cut 10 */
|
||||
#elif RCAR_LSI_CUT == RCAR_CUT_11
|
||||
/* H3 Cut 11 */
|
||||
#else
|
||||
/* H3 Cut 20 */
|
||||
/* H3 Cut 30 or later */
|
||||
refperiod = REFPERIOD_CYCLE;
|
||||
#endif
|
||||
#elif RCAR_LSI == RCAR_H3N
|
||||
/* H3N Cut 30 or later */
|
||||
refperiod = REFPERIOD_CYCLE;
|
||||
#elif RCAR_LSI == RCAR_M3
|
||||
#if RCAR_LSI_CUT == RCAR_CUT_10
|
||||
/* M3 Cut 10 */
|
||||
#else
|
||||
/* M3 Cut 11 */
|
||||
/* M3 Cut 13 */
|
||||
/* M3 Cut 30 or later */
|
||||
refperiod = REFPERIOD_CYCLE;
|
||||
#endif
|
||||
#elif RCAR_LSI == RCAR_M3N /* for M3N */
|
||||
refperiod = REFPERIOD_CYCLE;
|
||||
#endif
|
||||
|
||||
return refperiod;
|
||||
}
|
||||
#endif
|
||||
|
||||
void rcar_qos_dbsc_setting(struct rcar_gen3_dbsc_qos_settings *qos,
|
||||
unsigned int qos_size, bool dbsc_wren)
|
||||
{
|
||||
int i;
|
||||
|
||||
/* Register write enable */
|
||||
if (dbsc_wren)
|
||||
io_write_32(DBSC_DBSYSCNT0, 0x00001234U);
|
||||
|
||||
for (i = 0; i < qos_size; i++)
|
||||
io_write_32(qos[i].reg, qos[i].val);
|
||||
|
||||
/* Register write protect */
|
||||
if (dbsc_wren)
|
||||
io_write_32(DBSC_DBSYSCNT0, 0x00000000U);
|
||||
}
|
||||
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